traitement du signal et logique (MPI) · Chapitre 3 · Application directe du cours
Complément – Demi-additionneur et additionneur complet
Portes logiques · niveau 2
Énoncé
(Complément : les additionneurs ne sont pas au programme.) L'additionneur complet reçoit deux bits , et la retenue entrante ; il délivre le bit de somme et la retenue sortante . Dresser sa table, montrer que , et exprimer .
Corrigé
La somme de trois bits vaut , , ou , écrite en binaire :
| 0 | 0 | 0 | 0 | 0 |
| 0 | 0 | 1 | 0 | 1 |
| 0 | 1 | 0 | 0 | 1 |
| 0 | 1 | 1 | 1 | 0 |
| 1 | 0 | 0 | 0 | 1 |
| 1 | 0 | 1 | 1 | 0 |
| 1 | 1 | 0 | 1 | 0 |
| 1 | 1 | 1 | 1 | 1 |
Le bit de somme vaut lorsque le nombre de parmi est impair (1 ou 3). Or vaut précisément si et seulement si ce nombre est impair (le XOR est une somme modulo , associative) : , la parité des trois bits, la fonction même que réalise un va-et-vient à trois endroits. La retenue vaut dès que deux bits au moins valent : c'est la fonction majorité, , qu'on écrit aussi : la retenue naît soit de et , soit de quand exactement un des deux bits vaut . Le demi-additionneur () donne et .
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